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연산 증폭기 회로 프로젝트
연산 증폭기 (OPAMP 자주 또는 OPAMP) 차동 입력하고, 통상, 단일 종단 출력 DC 커플 고 이득 전자 전압 증폭기이다 [1]. 이 구성에서는, 연산 증폭기는 통상적으로 그것의 입력 단자 사이의 전위차보다 큰 수십만 번이다 (회로 접지에 대하여)의 출력 전위를 생성한다. 연산 증폭기는 많은 선형, 비선형 및 주파수 의존 회로에서 수학 연산을 수행하는 데 사용 된 아날로그 컴퓨터, 자신의 기원을했다.

아날로그 회로에서 빌딩 블록으로서 연산 증폭기의 인기는 다양성 때문이다. 음의 피드백을 사용함으로써, 연산 증폭기 회로의 이득, 입력 및 출력 임피던스의 특성 등 대역폭은 외부 구성 요소들에 의해 결정되며, 연산 증폭기 자체의 온도 계수 또는 제조 변화에 거의 의존해야한다.

연산 증폭기는 가장 널리 사용되는 전자 기기 사이에서 오늘날 소비자, 산업, 과학 장비의 광대 한 배열에 사용된다. 많은 표준 IC의 연산 증폭기는 적당한 생산량 몇 센트; 그러나, 특수 성능 사양을 일부 통합 또는 하이브리드 연산 증폭기는 소량 이상 US $ 100의 비용 할 수있다. [2] 연산 증폭기 구성 요소로 패키지화 또는보다 복잡한 집적 회로 소자로서 사용될 수있다.

연산 증폭기는 차동 증폭기의 하나 개의 유형이다. 차동 증폭기의 다른 유형은 완전 차동 (연산 증폭기와 유사하지만 두 개의 출력으로) 앰프 (일반적으로 세 개의 연산 증폭기에서 내장), 계측 증폭기, 계측 증폭기 유사한 절연 증폭기 (하지만 허용 오차를 포함 통상의 연산 증폭기를 파괴 할 공통 모드 전압) 및 네거티브 피드백 증폭기 (보통 하나 이상의 연산 증폭기 및 피드백 저항 네트워크를 구축)